世界知名電子企業(yè)筆試題
世界知名電子企業(yè)面試官在筆試這一環(huán)節(jié)中，最喜歡考那種類型的筆試題呢？大學(xué)網(wǎng)為大家很多關(guān)于這一行業(yè)的筆試題，大家不看會(huì)很可惜，
世界知名電子企業(yè)筆試題
。
1、基爾霍夫定理的內(nèi)容是什么？（仕蘭微電子）
基爾霍夫電流定律是一個(gè)電荷守恒定律,即在一個(gè)電路中流入一個(gè)節(jié)點(diǎn)的電荷與流出同一個(gè)節(jié)點(diǎn)的電荷相等。
基爾霍夫電壓定律是一個(gè)能量守恒定律,即在一個(gè)回路中回路電壓之和為零。
2、平板電容公式(C=εS/4πkd)。（未知）
3、最基本的如三極管曲線特性。（未知）
4、描述反饋電路的概念，列舉他們的應(yīng)用。（仕蘭微電子）
5、負(fù)反饋種類（電壓并聯(lián)反饋，電流串聯(lián)反饋，電壓串聯(lián)反饋和電流并聯(lián)反饋）；負(fù)反饋的優(yōu)點(diǎn)（降低放大器的增益靈敏度，改變輸入電阻和輸出電阻，改善放大器的線性和非線性失真，有效地?cái)U(kuò)展放大器的通頻帶，自動(dòng)調(diào)節(jié)作用）（未知）
6、放大電路的頻率補(bǔ)償?shù)哪康氖鞘裁�，有哪些方法？（仕蘭微電子）
7、頻率響應(yīng)，如：怎么才算是穩(wěn)定的，如何改變頻響曲線的幾個(gè)方法。（未知）
8、給出一個(gè)查分運(yùn)放，如何相位補(bǔ)償，并畫補(bǔ)償后的波特圖。（凹凸）
9、基本放大電路種類（電壓放大器，電流放大器，互導(dǎo)放大器和互阻放大器），優(yōu)缺點(diǎn)，特別是廣泛采用差分結(jié)構(gòu)的原因。（未知）
10、給出一差分電路，告訴其輸出電壓Y和Y-,求共模分量和差模分量。（未知）
11、畫差放的兩個(gè)輸入管。（凹凸）
12、畫出由運(yùn)放構(gòu)成加法、減法、微分、積分運(yùn)算的電路原理圖。并畫出一個(gè)晶體管級(jí)的運(yùn)放電路。（仕蘭微電子）
13、用運(yùn)算放大器組成一個(gè)10倍的放大器。（未知）
14、給出一個(gè)簡(jiǎn)單電路，讓你分析輸出電壓的特性（就是個(gè)積分電路），并求輸出端某點(diǎn)的rise/fall時(shí)間。(Infineon筆試試題)
15、電阻R和電容C串聯(lián)，輸入電壓為R和C之間的電壓，輸出電壓分別為C上電壓和R上電壓，要求制這兩種電路輸入電壓的頻譜，判斷這兩種電路何為高通濾波器，何為低通濾波器。當(dāng)RC18、說說靜態(tài)、動(dòng)態(tài)時(shí)序模擬的優(yōu)缺點(diǎn)。（威盛VIA2003.11.06上海筆試試題）
16、一個(gè)四級(jí)的Mux,其中第二級(jí)信號(hào)為關(guān)鍵信號(hào)如何改善timing。（威盛VIA2003.11.06上海筆試試題）
17、給出一個(gè)門級(jí)的圖，又給了各個(gè)門的傳輸延時(shí)，問關(guān)鍵路徑是什么，還問給出輸入，使得輸出依賴于關(guān)鍵路徑。（未知）
18、邏輯方面數(shù)字電路的卡諾圖化簡(jiǎn)，時(shí)序（同步異步差異），觸發(fā)器有幾種（區(qū)別，優(yōu)點(diǎn)），全加器等等。（未知）
19、卡諾圖寫出邏輯表達(dá)使。（威盛VIA2003.11.06上海筆試試題）
20、化簡(jiǎn)F(A,B,C,D)=m(1,3,4,5,10,11,12,13,14,15)的和。（威盛）
21、pleaseshowtheCMOSinverterschmatic,layoutanditscrosssectionwithP-wellprocess.Plotitstransfercurve(Vout-Vin)
AndalsoexplaintheoperationregionofPMOSandNMOSforeachsegmentofthetransfercurve?（威盛筆試題circuitdesign-beijing-03.11.09）
22、TodesignaCMOSinvertorwithbalanceriseandfalltime,pleasedefinetherationofchannelwidthofPMOSandNMOSandexplain?
23、為什么一個(gè)標(biāo)準(zhǔn)的倒相器中P管的寬長(zhǎng)比要比N管的寬長(zhǎng)比大？（仕蘭微電子）
24、用mos管搭出一個(gè)二輸入與非門。（揚(yáng)智電子筆試）
25、pleasedrawthetransistorlevelschematicofacmos2inputANDgateandexplainwhichinputhasfasterresponseforoutputrisingedge.(lessdelaytime)。（威盛筆試題circuitdesign-beijing-03.11.09）
26、畫出NOT,NAND,NOR的符號(hào)，真值表，還有transistorlevel的電路。（Infineon筆試）30、畫出CMOS的圖，畫出tow-to-onemuxgate。（威盛VIA2003.11.06上海筆試試題）
27、用一個(gè)二選一mux和一個(gè)inv實(shí)現(xiàn)異或。（飛利浦－大唐筆試）
28、畫出Y=A*BC的cmos電路圖。（科廣試題）
29、用邏輯們和cmos電路實(shí)現(xiàn)abcd。（飛利浦－大唐筆試）
30、畫出CMOS電路的晶體管級(jí)電路圖，實(shí)現(xiàn)Y=A*BC(DE)。（仕蘭微電子）
31、利用4選1實(shí)現(xiàn)F(x,y,z)=xzyz’。（未知）
32、給一個(gè)表達(dá)式f=xxxxxxxxxxxxxxxxx用最少數(shù)量的與非門實(shí)現(xiàn)（實(shí)際上就是化簡(jiǎn)）。
33、給出一個(gè)簡(jiǎn)單的由多個(gè)NOT,NAND,NOR組成的原理圖，根據(jù)輸入波形畫出各點(diǎn)波形。（Infineon筆試）
34、為了實(shí)現(xiàn)邏輯（AXORB）OR（CANDD），請(qǐng)選用以下邏輯中的一種，并說明為什么？1）INV2）AND3）OR4）NAND5）NOR6）XOR答案：NAND（未知）
35、用與非門等設(shè)計(jì)全加法器。（華為）
36、給出兩個(gè)門電路讓你分析異同。（華為）
37、用簡(jiǎn)單電路實(shí)現(xiàn)，當(dāng)A為輸入時(shí)，輸出B波形為…（仕蘭微電子）
38、A,B,C,D,E進(jìn)行投票，多數(shù)服從少數(shù)，輸出是F（也就是如果A,B,C,D,E中1的個(gè)數(shù)比0多，那么F輸出為1，否則F為0），用與非門實(shí)現(xiàn)，輸入數(shù)目沒有限制。（未知）
39、用波形表示D觸發(fā)器的功能，
資料共享平臺(tái)
《世界知名電子企業(yè)筆試題》(http://www.msguai.com)。（揚(yáng)智電子筆試）40、用傳輸門和倒向器搭一個(gè)邊沿觸發(fā)器。（揚(yáng)智電子筆試）
41、用邏輯們畫出D觸發(fā)器。（威盛VIA2003.11.06上海筆試試題）
42、畫出DFF的結(jié)構(gòu)圖,用verilog實(shí)現(xiàn)之。（威盛）
43、畫出一種CMOS的D鎖存器的電路圖和版圖。（未知）
44、D觸發(fā)器和D鎖存器的區(qū)別。（新太硬件面試）
45、簡(jiǎn)述latch和filp-flop的異同。（未知）
&e1]5T'v&n.g*_1D+J50、LATCH和DFF的概念和區(qū)別。（未知）
46、latch與register的`區(qū)別,為什么現(xiàn)在多用register.行為級(jí)描述中l(wèi)atch如何產(chǎn)生的。（南山之橋）
47、用D觸發(fā)器做個(gè)二分顰的電路.又問什么是狀態(tài)圖。（華為）
48、請(qǐng)畫出用D觸發(fā)器實(shí)現(xiàn)2倍分頻的邏輯電路？（漢王筆試）
49、怎樣用D觸發(fā)器、與或非門組成二分頻電路？（東信筆試）
50、Howmanyflip-flopcircuitsareneededtodivideby16?(Intel)16分頻？
51、用filp-flop和logic-gate設(shè)計(jì)一個(gè)1位加法器，輸入carryin和current-stage，輸出carryout和next-stage.（未知）
52、用D觸發(fā)器做個(gè)4進(jìn)制的計(jì)數(shù)。（華為）
53、實(shí)現(xiàn)N位JohnsonCounter,N=5。（南山之橋）
54、用你熟悉的設(shè)計(jì)方式設(shè)計(jì)一個(gè)可預(yù)置初值的7進(jìn)制循環(huán)計(jì)數(shù)器，15進(jìn)制的呢？（仕蘭微電子）
55、數(shù)字電路設(shè)計(jì)當(dāng)然必問Verilog/VHDL，如設(shè)計(jì)計(jì)數(shù)器。（未知）
56、BLOCKINGNONBLOCKING賦值的區(qū)別。（南山之橋）
57、寫異步D觸發(fā)器的verilogmodule。（揚(yáng)智電子筆試）
moduledff8(clk,reset,d,q);
inputclk;
inputreset;
input[7:0]d;
output[7:0]q;
reg[7:0]q;
always@(posedgeclkorposedgereset)
if(reset)
q<=0;
,L.W/\.~)R!
q<=d;
&cI!K,\;
58、用D觸發(fā)器實(shí)現(xiàn)2倍分頻的Verilog描述？（漢王筆試）
moduledivide2(clk,clk_o,reset);
inputclk,reset;
outputclk_o;
wirein;
out;
always@(posedgeclkorposedgereset)
if(reset)
out<=0;else
59、可編程邏輯器件在現(xiàn)代電子設(shè)計(jì)中越來越重要，請(qǐng)問：a)你所知道的可編程邏輯器件有哪些？b)試用VHDL或VERILOG、ABLE描述8位D觸發(fā)器邏輯。（漢王筆試）
)r'T'y)d:S:a0VPAL，PLD，CPLD，F(xiàn)PGA。
moduledff8(clk,reset,d,q);
inputclk;
7B*M"D9t"Q*jinputreset;
inputd;
&O.A%H1k/s8Voutputq;
regq;
always@(posedgeclkorposedgereset)
if(reset)
q<=0;
'p8w'P'S2pelse
q<=d;
60、請(qǐng)用HDL描述四位的全加法器、5分頻電路。（仕蘭微電子）
61、用VERILOG或VHDL寫一段代碼，實(shí)現(xiàn)消除一個(gè)glitch。（未知）
62、一個(gè)狀態(tài)機(jī)的題目用verilog實(shí)現(xiàn)（不過這個(gè)狀態(tài)機(jī)畫的實(shí)在比較差，很容易誤解的）。（威盛VIA2003.11.06上海筆試試題）
63、描述一個(gè)交通信號(hào)燈的設(shè)計(jì)。（仕蘭微電子）
65、畫狀態(tài)機(jī)，接受1，2，5分錢的賣報(bào)機(jī)，每份報(bào)紙5分錢。（揚(yáng)智電子筆試）
9p-g0]/V*U8U7v*.com.cn71、設(shè)計(jì)一個(gè)自動(dòng)售貨機(jī)系統(tǒng)，賣soda水的，只能投進(jìn)三種硬幣，要正確的找回錢數(shù)。（1）畫出fsm（有限狀態(tài)機(jī)）；（2）用verilog編程，語法要符合fpga設(shè)計(jì)的要求。（未知）
66、設(shè)計(jì)一個(gè)自動(dòng)飲料售賣機(jī)，飲料10分錢，硬幣有5分和10分兩種，并考慮找零：（1）畫出fsm（有限狀態(tài)機(jī)）；（2）用verilog編程，語法要符合fpga設(shè)計(jì)的要求；（3）設(shè)計(jì)工程中可使用的工具及設(shè)計(jì)大致過程。（未知）
67、畫出可以檢測(cè)10010串的狀態(tài)圖,并verilog實(shí)現(xiàn)之。（威盛）
68、用FSM實(shí)現(xiàn)101101的序列檢測(cè)模塊。（南山之橋）
a為輸入端，b為輸出端，如果a連續(xù)輸入為1101則b輸出為1，否則為0。例如a：0001100110110100100110
b：0000000000100100000000
請(qǐng)畫出statemachine；請(qǐng)用RTL描述其statemachine。（未知）
更多相關(guān)的筆試題目，大家敬請(qǐng)繼續(xù)閱讀：java筆試題 愛立信技術(shù)類筆試題 外貿(mào)業(yè)務(wù)主管筆試題
【世界知名電子企業(yè)筆試題】相關(guān)文章：
7.360筆試題目
8.360筆試題目